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Doc-9M52G0；本文是“通信或电子”中“电子设计”的实用应用文的论文参考范文或相关资料文档。正文共1,883字，word格式文档。内容摘要：用verilog建立可综合模型的原则，不使用initial，不使用#10，不使用循环次数不确定的循环语句，如forever、while等，不使用用户自定义原语（UDP元件，尽量使用同步方式设计电路，除非是关键路径的设计，用always过程块描述组合逻辑，所有的内部寄存器都应该能够被复位，对时序逻辑描述..